TMS320 C6000 DSP結構原理與硬件設計簡(jiǎn)介，目錄書(shū)摘
2019-10-15 17:23
來(lái)源：京東
作者：京東
TMS320 C6000 DSP結構原理與硬件設計
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編輯推薦: 《TMS320 C6000 DSP結構原理與硬件設計》可作為電子信息、通信工程、汁算機應用及自動(dòng)控制等專(zhuān)業(yè)高年級本科生或研究生的教學(xué)參考書(shū)，也可供從事DSP應用系統設計的科技術(shù)人員使用。
內容簡(jiǎn)介: 介紹TI公司的TMS320 C6000系列DSP的結構原理和硬件設計方法，主要以定點(diǎn)C62X和浮點(diǎn)C67X為描述對象， 全面剖析高度并行的CPU內核、分層次的存儲器結構和豐富的集成外圍模塊，詳細分析CPU、存儲器，EDMA、EMIF、HPI、McBSP、McASP、I2C總線(xiàn),GPIO、定時(shí)器、擴展總線(xiàn)、PCI總線(xiàn)、鎖相環(huán)和節能邏輯等部分的結構原理與使用方法，并給出基于C6713 DSP的實(shí)際應用系統的硬件設計實(shí)例。
本書(shū)可作為電子信息、通信工程、計算機應用及自動(dòng)控制等專(zhuān)業(yè)高年級本科生或研究生的教學(xué)參考書(shū)，也可供從事DSP應用系統設計的科技術(shù)人員使用。
本書(shū)可作為電子信息、通信工程、計算機應用及自動(dòng)控制等專(zhuān)業(yè)高年級本科生或研究生的教學(xué)參考書(shū)，也可供從事DSP應用系統設計的科技術(shù)人員使用。
目錄:第1章 TMS320 C6000系列DSP簡(jiǎn)介
1.1 概述
1.2 C6000 DSP的定點(diǎn)和浮點(diǎn)系列及代碼兼容性
1.3 TMS320 C6000 DSP技術(shù)特征
1.3.1 高度并行的CPU結構
1.3.2 靈活的存儲器配置
1.3.3 豐富的外設模塊
1.4 本書(shū)的結構安排與導讀
第2章 中央處理單元CPU工作原理分析
2.1 CPU的組成單元
2.2 CPU的程序執行機構 數據通道
2.2.1 通用寄存器組A和B
2.2.2 功能單元與指令映射
2.2.3 寄存器組交叉路徑
2.2.4 數據存儲器的讀取和存儲路徑
2.2.5 數據地址路徑與尋址方式
2.3 CPU的取指、譯碼與分配機制一流水線(xiàn)操作
2.3.1 取指階段
2.3.2 譯碼階段
2.3.3 執行階段
2.4 控制寄存器
2.5 中斷控制與中斷選擇
2.5.1 中斷類(lèi)型與優(yōu)先級
2.5.2 有關(guān)中斷的控制寄存器
2.5.3 中斷服務(wù)表
2.5.4 中斷選擇
第3章 C6000 DSP內部存儲器結構分析
3.1 C6000 DSP的存儲器映射
3.2 C620X/C670X DSP片內存儲器結構
3.2.1 片內程序存儲器的管理與工作模式
3.2.2 C620X/C670X DSP的片內數據存儲器
3.3 C621X/C671X DSP片內分層的存儲器結構
3.3.1 第一級數據緩存LlD
3.3.2 第一級程序緩存L1P
3.3.3 第二級存儲器L2
3.4 存儲器的控制寄存器
3.5 高速緩存的管理
第4章 增強的直接存儲器訪(fǎng)問(wèn)EDMA結構與原理
4.1 EDMA概述
4.1.1 直接存儲器訪(fǎng)問(wèn)
4.1.2 增強型直接存儲器訪(fǎng)問(wèn)
4.2 EDMA基本結構
4.2.1 EDMA的組成
4.2.2 參數RAM體說(shuō)明
4.3 EDMA控制寄存器
4.3.1 EDMA事件選擇寄存器ESE1
4.3.2 EDMA優(yōu)先級隊列狀態(tài)寄存器PQSR
4.3.3 EDMA通道中斷掛起寄存器CIPR
4.3.4 EDMA通道中斷使能寄存器CIER
4.3.5 EDMA通道鏈接使能寄存器CCER
4.3.6 EDMA事件寄存器ER
4.3.7 EDMA事件使能寄存器EER
4.3.8 EDMA事件清除寄存器ECR
4.3.9 EDMA事件設置寄存器ESR
4.4 EDMA的傳輸過(guò)程
4.4.1 EDMA的初始化與啟動(dòng)
4.4.2 EDMA傳輸的同步控制
4.4.3 EDMA傳輸的類(lèi)型
4.4.4 單元大小和汁數更新
4.4.5 源地址/目的地址更新
4.4.6 鏈接和終止一個(gè)EDMA傳輸
4.4.7 EDMA的性能分析
4.5 快速直接存儲器訪(fǎng)問(wèn)工作原理
4.5.1 初始化一個(gè)QDMA傳輸
4.5.2 QDMA寄存器
4.5.3 QDMA性能分析和優(yōu)先級
4.6 EDMA應用實(shí)例
4.6.1 單元同步的一維到一維數據傳輸
4.6.2 陣列同步的二維到二維數據傳輸
4.6.3 塊同步的一維到二維數據傳輸
第5章 外部存儲器接口EMIF結構原理與使用
5.1 EMIF概述
5.2 EMIF接口信號與說(shuō)明
5.3 EMIF的控制寄存器
5.3.1 EMIF全局控制寄存器GBICTL
5.3.2 EMIFCE空問(wèn)控制寄存器CECTI.0～3
5.3.3 EMIF SDRAM控制寄存器SDCTI
5.3.4 EMIF SDRAM時(shí)序控制寄存器SDTIM
5.3.5 EMIF SDRAM擴展寄存器SDEXT
5.4 EMIF與存儲器的接口及時(shí)序說(shuō)明
5.4.1 存儲器寬度
5.4.2 EMIF存儲請求優(yōu)先級
5.4.3 EMIF的SDRAM接口及時(shí)序說(shuō)明
5.4.4 EMIF的SBSRAM接口及時(shí)序說(shuō)明
5.4.5 EMIF的ASRAM接口
5.5 EMIF使用實(shí)例
5.5.1 EMIF與異步FIFO存儲器的接口實(shí)例
5.5.2 EMIF與FLASH存儲器接口實(shí)例
第6章 主機接口HPI的結構原理與應用
第7章 多通道緩沖串行口McBSP結構原理與應用
第8章 多通道音頻串行口McASP結構原理與應用
第9章 定時(shí)器結構與工作原理
第10章 12C模塊的原理與使用
第11章 通用目的輸入輸出GPIO的功能分析
第12章 外圍設備互連PCI接口原理
第13章 擴展總線(xiàn)XBUS的原理和應用
第14章 鎖相環(huán)控制器和節能模式的工作原理
第15章 C6000 DSP應用系統的硬件設計
附 錄 TMS320 C6713 DSP分組信號描述
參考文獻
1.1 概述
1.2 C6000 DSP的定點(diǎn)和浮點(diǎn)系列及代碼兼容性
1.3 TMS320 C6000 DSP技術(shù)特征
1.3.1 高度并行的CPU結構
1.3.2 靈活的存儲器配置
1.3.3 豐富的外設模塊
1.4 本書(shū)的結構安排與導讀
第2章 中央處理單元CPU工作原理分析
2.1 CPU的組成單元
2.2 CPU的程序執行機構 數據通道
2.2.1 通用寄存器組A和B
2.2.2 功能單元與指令映射
2.2.3 寄存器組交叉路徑
2.2.4 數據存儲器的讀取和存儲路徑
2.2.5 數據地址路徑與尋址方式
2.3 CPU的取指、譯碼與分配機制一流水線(xiàn)操作
2.3.1 取指階段
2.3.2 譯碼階段
2.3.3 執行階段
2.4 控制寄存器
2.5 中斷控制與中斷選擇
2.5.1 中斷類(lèi)型與優(yōu)先級
2.5.2 有關(guān)中斷的控制寄存器
2.5.3 中斷服務(wù)表
2.5.4 中斷選擇
第3章 C6000 DSP內部存儲器結構分析
3.1 C6000 DSP的存儲器映射
3.2 C620X/C670X DSP片內存儲器結構
3.2.1 片內程序存儲器的管理與工作模式
3.2.2 C620X/C670X DSP的片內數據存儲器
3.3 C621X/C671X DSP片內分層的存儲器結構
3.3.1 第一級數據緩存LlD
3.3.2 第一級程序緩存L1P
3.3.3 第二級存儲器L2
3.4 存儲器的控制寄存器
3.5 高速緩存的管理
第4章 增強的直接存儲器訪(fǎng)問(wèn)EDMA結構與原理
4.1 EDMA概述
4.1.1 直接存儲器訪(fǎng)問(wèn)
4.1.2 增強型直接存儲器訪(fǎng)問(wèn)
4.2 EDMA基本結構
4.2.1 EDMA的組成
4.2.2 參數RAM體說(shuō)明
4.3 EDMA控制寄存器
4.3.1 EDMA事件選擇寄存器ESE1
4.3.2 EDMA優(yōu)先級隊列狀態(tài)寄存器PQSR
4.3.3 EDMA通道中斷掛起寄存器CIPR
4.3.4 EDMA通道中斷使能寄存器CIER
4.3.5 EDMA通道鏈接使能寄存器CCER
4.3.6 EDMA事件寄存器ER
4.3.7 EDMA事件使能寄存器EER
4.3.8 EDMA事件清除寄存器ECR
4.3.9 EDMA事件設置寄存器ESR
4.4 EDMA的傳輸過(guò)程
4.4.1 EDMA的初始化與啟動(dòng)
4.4.2 EDMA傳輸的同步控制
4.4.3 EDMA傳輸的類(lèi)型
4.4.4 單元大小和汁數更新
4.4.5 源地址/目的地址更新
4.4.6 鏈接和終止一個(gè)EDMA傳輸
4.4.7 EDMA的性能分析
4.5 快速直接存儲器訪(fǎng)問(wèn)工作原理
4.5.1 初始化一個(gè)QDMA傳輸
4.5.2 QDMA寄存器
4.5.3 QDMA性能分析和優(yōu)先級
4.6 EDMA應用實(shí)例
4.6.1 單元同步的一維到一維數據傳輸
4.6.2 陣列同步的二維到二維數據傳輸
4.6.3 塊同步的一維到二維數據傳輸
第5章 外部存儲器接口EMIF結構原理與使用
5.1 EMIF概述
5.2 EMIF接口信號與說(shuō)明
5.3 EMIF的控制寄存器
5.3.1 EMIF全局控制寄存器GBICTL
5.3.2 EMIFCE空問(wèn)控制寄存器CECTI.0～3
5.3.3 EMIF SDRAM控制寄存器SDCTI
5.3.4 EMIF SDRAM時(shí)序控制寄存器SDTIM
5.3.5 EMIF SDRAM擴展寄存器SDEXT
5.4 EMIF與存儲器的接口及時(shí)序說(shuō)明
5.4.1 存儲器寬度
5.4.2 EMIF存儲請求優(yōu)先級
5.4.3 EMIF的SDRAM接口及時(shí)序說(shuō)明
5.4.4 EMIF的SBSRAM接口及時(shí)序說(shuō)明
5.4.5 EMIF的ASRAM接口
5.5 EMIF使用實(shí)例
5.5.1 EMIF與異步FIFO存儲器的接口實(shí)例
5.5.2 EMIF與FLASH存儲器接口實(shí)例
第6章 主機接口HPI的結構原理與應用
第7章 多通道緩沖串行口McBSP結構原理與應用
第8章 多通道音頻串行口McASP結構原理與應用
第9章 定時(shí)器結構與工作原理
第10章 12C模塊的原理與使用
第11章 通用目的輸入輸出GPIO的功能分析
第12章 外圍設備互連PCI接口原理
第13章 擴展總線(xiàn)XBUS的原理和應用
第14章 鎖相環(huán)控制器和節能模式的工作原理
第15章 C6000 DSP應用系統的硬件設計
附 錄 TMS320 C6713 DSP分組信號描述
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